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ちょっと違う?
ハードウェア記述言語であって、プログラミング言語ではないから…、って意味だとASN.1も怪しいよな。
まあ、普及度ではVerilogと2大勢力なのでやっぱり違うような#10年前は2大勢力だったと思うけど今は知らない
その系統だとどっちかってーと Bluespec [bluespec.com] とかでは?
#使ったことありません
プログラミング言語ならば、ここはtclを挙げるのが順当か
ハードウェア記述言語とプログラミング言語の違いは何?
SystemVerilogでClassとかオブジェクトを作りまくってC言語で書かれたモデルともインタフェースして、UVMはデザインパターンのファクトリを使うけどやっぱりプログラミング言語ではないのかな?
ハード屋さんはそれを使うとき「設計」といっていて、土方屋さんはそれを使うとき「実装」とよぶ。
# いまだに設計と実装のフェーズを分けるとか意味不明
もとACです。解説ありがとう。
なるほど、ソフト屋(ってざっくりまとめすぎですが)ではデバッグって言われそうな工程が実装になっているのですね。
ちなみに元コメントの意図は、ソフト界隈では設計とコーディングのフェーズをわけたり、別の人間に割り当てる不思議があって、それを揶揄したコメントでした。
その昔、「おれは机上で変数名まで設計してからエディタでプログラムを書く」というご老体のお話を聞いて、「それ、机上で書いてるし」と思ったのはいい思い出です。# いまでもそんなとこあるんですかねぇ。
別ACですが。ソフトで言うデバッグの行程は、IC設計でいう実装(配置配線)の行程とは別にあります。IC設計の実装に相当する工程は、ソフト開発では今現在は存在しないと思います。ソフト設計で言えば、最適化やコンパイルの部分ですが、今はコンパイラにお任せですね。
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物事のやり方は一つではない -- Perlな人
VHDL (スコア:0)
ちょっと違う?
Re:VHDL (スコア:0)
ハードウェア記述言語であって、プログラミング言語ではないから…、
って意味だとASN.1も怪しいよな。
まあ、普及度ではVerilogと2大勢力なのでやっぱり違うような
#10年前は2大勢力だったと思うけど今は知らない
Re: (スコア:0)
その系統だとどっちかってーと Bluespec [bluespec.com] とかでは?
#使ったことありません
Re: (スコア:0)
プログラミング言語ならば、ここはtclを挙げるのが順当か
Re: (スコア:0)
Re: (スコア:0)
ハードウェア記述言語とプログラミング言語の違いは何?
SystemVerilogでClassとかオブジェクトを作りまくって
C言語で書かれたモデルともインタフェースして、
UVMはデザインパターンのファクトリを使うけどやっぱり
プログラミング言語ではないのかな?
Re: (スコア:0)
ハード屋さんはそれを使うとき「設計」といっていて、
土方屋さんはそれを使うとき「実装」とよぶ。
# いまだに設計と実装のフェーズを分けるとか意味不明
Re: (スコア:0)
HDLで書かれた回路をコンパイルして実際の回路(ネットリスト)にして、配置配線してそれを基に各信号のタイミング調整をして(タイミングの制約が満たされるまで以上を繰り返し)って工程のことです。
Re: (スコア:0)
もとACです。
解説ありがとう。
なるほど、ソフト屋(ってざっくりまとめすぎですが)ではデバッグって
言われそうな工程が実装になっているのですね。
ちなみに元コメントの意図は、ソフト界隈では設計とコーディングのフェーズをわけたり、
別の人間に割り当てる不思議があって、それを揶揄したコメントでした。
その昔、「おれは机上で変数名まで設計してからエディタでプログラムを書く」
というご老体のお話を聞いて、「それ、机上で書いてるし」と思ったのは
いい思い出です。
# いまでもそんなとこあるんですかねぇ。
Re: (スコア:0)
別ACですが。
ソフトで言うデバッグの行程は、IC設計でいう実装(配置配線)の行程とは別にあります。
IC設計の実装に相当する工程は、ソフト開発では今現在は存在しないと思います。
ソフト設計で言えば、最適化やコンパイルの部分ですが、今はコンパイラにお任せですね。